IRES: Development of Global Scientists and Engineers by Collaborative Research on Variation-Aware Nanometer IC Design
IRES:通过变异感知纳米 IC 设计的合作研究来促进全球科学家和工程师的发展
基本信息
- 批准号:1130402
- 负责人:
- 金额:$ 15万
- 依托单位:
- 依托单位国家:美国
- 项目类别:Standard Grant
- 财政年份:2011
- 资助国家:美国
- 起止时间:2011-08-01 至 2015-07-31
- 项目状态:已结题
- 来源:
- 关键词:
项目摘要
This project will provide U.S. students with the opportunity to gain international research experience in verifying and designing nanometer silicon-based nanometer integrated computing and communication systems. U.S. students will spend four weeks per year at Tsinghua University in Beijing, China. This project will support the collaborative research and education activities between the MSLAB Lab at University of California at Riverside and the Design Automation Lab (EDA) at Tsinghua University of China. The team will jointly tackle the challenges of verifying and designing silicon-based nanometer VLSI systems. The collaborative research projects will focus on the efficient statistical full-chip power estimation considering process variations with spatial correlations and chip yield improvement techniques due to power and timing variations. U.S. students will jointly develop new statistical leakage, dynamic and total power estimation techniques and statistical chip yield optimization techniques for design and optimization of nanometer high performance integrated computing and communication systems.Broader Impact. The proposed collaborative educational and research activities will provide unique training, mentoring, networking and intellectual development opportunities for U.S. students. Such international engagement will benefit the students' entire careers and help improve their competitiveness and competency as scientists and engineers. Finally, the joint research will strengthen existing computer engineering research and education programs, and broaden the collaborative research works at UC Riverside in synergy with one well-recognized and funded research program in China. The curriculum and textbook development will boost the VLSI design technique research at UC Riverside and promote the statistical VLSI performance modeling and estimation field as a scholarly discipline.
该项目将为美国学生提供在验证和设计纳米硅基纳米集成计算和通信系统方面获得国际研究经验的机会。美国学生每年将在中国北京的清华大学学习四个星期。该项目将支持加州大学河滨分校 MSLAB 实验室和中国清华大学设计自动化实验室 (EDA) 之间的合作研究和教育活动。 该团队将共同应对验证和设计硅基纳米超大规模集成电路系统的挑战。 合作研究项目将重点关注考虑空间相关性的工艺变化以及由于功率和时序变化而导致的芯片良率改进技术的高效统计全芯片功耗估计。美国学生将联合开发新的统计泄漏、动态和总功率估计技术以及统计芯片良率优化技术,用于纳米高性能集成计算和通信系统的设计和优化。产生更广泛的影响。拟议的合作教育和研究活动将为美国学生提供独特的培训、指导、网络和智力发展机会。这种国际参与将使学生的整个职业生涯受益,并有助于提高他们作为科学家和工程师的竞争力和能力。 最后,联合研究将加强现有的计算机工程研究和教育项目,并扩大加州大学河滨分校的合作研究工作,与中国一项得到广泛认可和资助的研究项目相协同。 课程和教科书的开发将推动加州大学河滨分校的VLSI设计技术研究,并推动统计VLSI性能建模和估计领域成为一门学术学科。
项目成果
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会议论文数量(0)
专利数量(0)
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