避免过度测试的时延测试生成方法
项目介绍
AI项目解读
基本信息
- 批准号:60776031
- 项目类别:面上项目
- 资助金额:28.0万
- 负责人:
- 依托单位:
- 学科分类:F0402.集成电路设计
- 结题年份:2010
- 批准年份:2007
- 项目状态:已结题
- 起止时间:2008-01-01 至2010-12-31
- 项目参与者:高文; 张旻晋; 王飞; 范小鑫; 付祥; 刘慧; 张颖; 付斌章;
- 关键词:
项目摘要
时延测试的目标是检测时延缺陷、确保设计满足期望的性能规范。随着集成电路工艺特征尺寸向超深亚微米、纳米级的持续推进,芯片内部速度不断增加,与性能相关的缺陷日趋严重,高速电路的时延测试非常重要,同时,由于时延测试的过度测试问题产生的成品率损失也日益受到关注。本项目分别从功能状态和功能环境两个角度分析时延测试的两类过度测试问题,探讨解决过度测试的时延测试生成方法。从功能状态出发,主要针对跳变时延故障,研究和提出避免非功能状态的时延测试生成方法及其算法,以确保产生的测试不会检测在功能操作下冗余的时延故障,从而避免第一类过度测试问题。从功能环境出发,主要针对通路时延故障,研究由电源噪声引起的供电衰减故障模型(PSDF),考虑电压降(IR-drop)对时延的影响,分析PSDF与通路时延故障的关系,提出PSDF的通路时延测试生成方法以及低功耗的时延测试生成算法,从而避免第二类过度测试问题。
结项摘要
项目成果
期刊论文数量(10)
专著数量(0)
科研奖励数量(0)
会议论文数量(19)
专利数量(3)
Test generation for maximal crosstalk effect
最大串扰效应的测试生成
- DOI:--
- 发表时间:--
- 期刊:Jisuanji Fuzhu Sheji Yu Tuxingxue Xuebao/Journal of Computer-Aided Design and Computer Graphics
- 影响因子:--
- 作者:张旻晋;李晓维;李华伟
- 通讯作者:李华伟
Flip-flop selection for partial enhanced-scan delay testing with high transition fault coverage
用于具有高转换故障覆盖率的部分增强扫描延迟测试的触发器选择
- DOI:--
- 发表时间:--
- 期刊:Jisuanji Fuzhu Sheji Yu Tuxingxue Xuebao/Journal of Computer-Aided Design and Computer Graphics
- 影响因子:--
- 作者:Li, Huawei;Pei, Songwei;Li, Xiaowei
- 通讯作者:Li, Xiaowei
MT compacted set for interconnect crosstalk on SoC
用于 SoC 上互连串扰的 MT 紧凑套件
- DOI:--
- 发表时间:--
- 期刊:Jisuanji Fuzhu Sheji Yu Tuxingxue Xuebao/Journal of Computer-Aided Design and Computer Graphics
- 影响因子:--
- 作者:李华伟;李晓维;胡瑜;张颖
- 通讯作者:张颖
Testable Critical Path Selection Considering Process Variation
考虑工艺变化的可测试关键路径选择
- DOI:10.1587/transinf.e93.d.59
- 发表时间:2010
- 期刊:IEICE Trans. Inf. Syst.
- 影响因子:--
- 作者:
- 通讯作者:
Testable Path Selection and Grouping for Faster Than At-Speed Testing
可测试路径选择和分组以实现比全速测试更快的速度
- DOI:10.1109/tvlsi.2010.2099243
- 发表时间:2012-02
- 期刊:IEEE Transactions on Very Large Scale Integration (VLSI) Systems
- 影响因子:2.8
- 作者:Xiaowei Li;Xiang Fu;Huawei Li
- 通讯作者:Huawei Li
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- 通讯作者:邝继顺
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