数字信号处理VLSI实现的可测性设计研究
项目介绍
AI项目解读
基本信息
- 批准号:90407007
- 项目类别:重大研究计划
- 资助金额:25.0万
- 负责人:
- 依托单位:
- 学科分类:F0402.集成电路设计
- 结题年份:2007
- 批准年份:2004
- 项目状态:已结题
- 起止时间:2005-01-01 至2007-12-31
- 项目参与者:王厚军; 童玲; 姜书艳; 习友宝; 王玉文; 王子斌; 殷时蓉; 王承;
- 关键词:
项目摘要
本项目针对当代数字信号处理对高速、高性能、高可靠性和低功耗的客观需求,以大规模集成电路(VLSI)实现数字信号处理的低功耗可测试性设计为研究对象,拟系统研究:(1)数字信号变换与运算在阵列化、并行化和流水化(Pipelined)VLSI实现的可测性设计理论与方法;(2)并行流水化数字滤波器VLSI实现的可测性设计原理与方法。该项目以取得自主创新的理论和技术成果为总体研究目标。该项目的实施对促进我国大规模集成电路可测性设计的理论研究和提高其应用水平,使我国跟上日新月异的国际微电子步伐皆具有积极意义。
结项摘要
项目成果
期刊论文数量(28)
专著数量(2)
科研奖励数量(0)
会议论文数量(7)
专利数量(0)
使用重复播种和Golomb编码的二维
- DOI:--
- 发表时间:--
- 期刊:计算机辅助设计与图形学学报.第17卷3期.394-399,2005年3月
- 影响因子:--
- 作者:胡兵;谢永乐
- 通讯作者:谢永乐
基于SVIC编码的SOC测试数据压缩
- DOI:--
- 发表时间:--
- 期刊:电子测量与仪器学报.第20卷1期.73-78,2006年2月
- 影响因子:--
- 作者:
- 通讯作者:
IIR滤波器的测试及可测性设计
- DOI:--
- 发表时间:--
- 期刊:计算机辅助设计与图形学学报.第19卷12期.203-209,2007年2月
- 影响因子:--
- 作者:
- 通讯作者:
减少SOC测试时间的测试结构配置
- DOI:--
- 发表时间:--
- 期刊:仪器仪表学报.第26卷8期.867-870,2005年8月
- 影响因子:--
- 作者:
- 通讯作者:
进位保留阵列乘法器的一种内建自
- DOI:--
- 发表时间:--
- 期刊:电子科技大学学报.第36卷4期.571-574,2007年8月
- 影响因子:--
- 作者:
- 通讯作者:
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其他文献
模拟集成电路的测试节点选择
- DOI:--
- 发表时间:--
- 期刊:电子与信息学报 26(4). 645-650, 2004.4
- 影响因子:--
- 作者:孙秀斌;陈光礻禹;谢永乐
- 通讯作者:谢永乐
模拟电路故障诊断中线性组合矩阵
- DOI:--
- 发表时间:--
- 期刊:系统工程与电子技术 27(5), 761-763 2005.5
- 影响因子:--
- 作者:孙秀斌;陈光礻禹;谢永乐
- 通讯作者:谢永乐
一种新的模拟集成电路输出参数测
- DOI:--
- 发表时间:--
- 期刊:仪器仪表学报 35(6), 784-787, 2004.12
- 影响因子:--
- 作者:孙秀斌;陈光礻禹;谢永乐
- 通讯作者:谢永乐
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- DOI:10.15961/j.jsuese.2016.04.022
- 发表时间:2016
- 期刊:四川大学学报(工程科学版)
- 影响因子:--
- 作者:周启忠;谢永乐
- 通讯作者:谢永乐
其他文献
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