A new class of expressions for reversible logic synthesis and its minimization algorithm
一类新的可逆逻辑综合表达式及其最小化算法
基本信息
- 批准号：24500053
- 负责人：
- 金额：$ 1.33万
- 依托单位：
- 依托单位国家：日本
- 项目类别：Grant-in-Aid for Scientific Research (C)
- 财政年份：2012
- 资助国家：日本
- 起止时间：2012-04-01 至 2015-03-31
- 项目状态：已结题
- 来源：
- 关键词：
项目摘要
项目成果
期刊论文数量（0）
专著数量（0）
科研奖励数量（0）
会议论文数量（0）
专利数量（0）
可逆論理回路合成のためのAND-EXOR論理式の簡単化アルゴリズム
可逆逻辑电路综合AND-EXOR逻辑公式的简化算法
- DOI：
- 发表时间：2014
- 期刊：
- 影响因子：0
- 作者：松尾亘;山中克久;平山貴司;西谷泰昭
- 通讯作者：西谷泰昭
A Lower Bound on the Gate Count of Toffoli-Based Reversible Logic Circuits
基于Toffoli的可逆逻辑电路门数的下界
- DOI：10.1587/transinf.2013lop0013
- 发表时间：2014
- 期刊：
- 影响因子：0.7
- 作者：油谷 創，枝廣 正人;小渕 裕之，三浦 崇，大津 金光，大川 猛，横田 隆史;T. Hirayama and H. Sugawara and K. Yamanaka and Y. Nishitani
- 通讯作者：T. Hirayama and H. Sugawara and K. Yamanaka and Y. Nishitani
Report on reversible logic synthesis and optimization techniques
可逆逻辑综合和优化技术报告
- DOI：
- 发表时间：
- 期刊：
- 影响因子：0
- 作者：星誠;渡邊眞之;小林徹哉;深瀬政秋;黒川敦;M. B. Ali and T. Hirayama
- 通讯作者：M. B. Ali and T. Hirayama
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HIRAYAMA Takashi其他文献
Function Design for Minimum Multiple-Control Toffoli Circuits of Reversible Adder/Subtractor Blocks and Arithmetic Logic Units
可逆加法器/减法器块和算术逻辑单元的最小多控制Toffoli电路的功能设计
- DOI：
10.1587/transfun.e101.a.2231 - 发表时间：
2018 - 期刊：
- 影响因子：0
- 作者：
ALI Md Belayet;HIRAYAMA Takashi;YAMANAKA Katsuhisa;NISHITANI Yasuaki - 通讯作者：
NISHITANI Yasuaki
A Polynomial Delay Algorithm for Enumerating 2-Edge-Connected Induced Subgraphs
枚举2边连通诱发子图的多项式延迟算法
- DOI：
10.1587/transinf.2021fcp0005 - 发表时间：
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- 影响因子：0.7
- 作者：
ITO Taishu;SANO Yusuke;YAMANAKA Katsuhisa;HIRAYAMA Takashi - 通讯作者：
HIRAYAMA Takashi
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Analysis of ABA response network using novel ABA response mutants of Arabidopsis
使用拟南芥新型 ABA 响应突变体分析 ABA 响应网络
- 批准号：
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$ 1.33万 - 项目类别：
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并行分布式计算及其应用
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07045019 - 财政年份：1995
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